本文介紹了如何準(zhǔn)確地估算采樣時鐘抖動，以及如何計算正確的上下整合邊界。
2012-04-01 10:19:38
1665 
本系列文章共有三部分，第 1 部分重點介紹如何準(zhǔn)確地估算某個時鐘源的抖動，以及如何將其與 ADC 的孔徑抖動組合。在第 2 部分中，該組合 抖動 將用于計算 ADC 的 SRN，然后將其與實際
2012-05-07 11:37:302668 
為了正確理解時鐘相關(guān)器件的抖動指標(biāo)規(guī)格，同時選擇抖動性能適合系統(tǒng)應(yīng)用的時鐘解決方案，本文詳細(xì)介紹了如何理解兩種類型時鐘驅(qū)動器的抖動參數(shù)，以及從鎖相環(huán)輸出噪聲特性理解時鐘器件作為合成器、抖動濾除功能時的噪聲特性。
2013-06-21 15:40:4114342 
-Si539x時鐘提升頻率靈活性和抖動性能--Si56x Ultra Series? XO/VCXO提供最大可達3GHz的任意頻率時鐘-。
2018-06-26 15:19:417075 今天我們將討論時鐘如何影響精密 ADC，涉及時鐘抖動、時鐘互調(diào)和時鐘的最佳 PCB 布局實踐。
2023-04-11 09:13:22645 時鐘抖動技術(shù)適合于各種周期性的脈沖信號，典型的是電力電子設(shè)備中的PWM電壓和數(shù)字電路中的時鐘信號。
2023-09-11 10:55:34503 
時鐘抖動是相對于理想時鐘沿實際時鐘存在不隨時間積累的、時而超前、時而滯后的偏移稱為時鐘抖動,簡稱抖動
2023-11-08 15:08:01892 
Silicon Labs日前擴展了Si539x抖動衰減器系列產(chǎn)品，其新器件型號具有完全集成的參考時鐘、增強了系統(tǒng)可靠性和性能，同時簡化了高速網(wǎng)絡(luò)設(shè)計中的PCB布局布線。
2019-06-20 16:16:564682 的148.35 MHz進入收發(fā)器的gtxe2_i（GTXE2_CHANNEL）。這適用于SDI。 LMH1983的27 MHZ時鐘進入控制I2C總線的過程，并從Si5324產(chǎn)生156.25 MHz時鐘
2020-05-11 08:09:08
BOARD EVALUATION SI5324
2023-03-29 22:53:25
SI5324-EVB，SI5324評估板，0.002至710 MHz時鐘發(fā)生器。 SI5324-EVB為評估SI5316任意速率精度時鐘提供平臺。 SI5316直接使用器件上的配置引腳進行控制
2019-02-22 09:30:51
Si5324 - Pin-Controlled 1_710 MHz Jitter Cleaning Clock - Silicon Laboratories
2022-11-04 17:22:44
嗨，Si5324已用于Xilinx參考設(shè)計（KC705評估板），可為10 gig SFP生成時鐘。https://www.xilinx.com/support/documentation
2020-05-12 09:20:29
在本文中，我們將討論抖動傳遞及其性能，以及相位噪聲測量技術(shù)的局限性。 時鐘抖動和邊沿速率 圖1顯示了由一個通用公式表述的三種波形。該公式包括相位噪聲項“φ(t)”和幅度噪聲項“λ(t)。對評估的三個
2022-11-23 07:59:49
如題，目前項目要做一個100m16bit的數(shù)據(jù)采集卡，看了下貴公司的AD9460，但是差分參考時鐘無法選擇？
需不需要加一個時鐘綜合芯片比如Si5324？但類似的這種芯片市場上很不好買到。
如果用elcosc能否推薦個廠家和芯片？還有ad9460能否申請樣品？謝謝
2023-12-25 07:44:39
如題，目前項目要做一個100m16bit的數(shù)據(jù)采集卡，看了下貴公司的AD9460，但是差分參考時鐘無法選擇？需不需要加一個時鐘綜合芯片比如Si5324？但類似的這種芯片市場上很不好買到。如果用elcosc能否推薦個廠家和芯片？還有ad9460能否申請樣品？謝謝
2018-11-28 09:24:25
ZC706開發(fā)板上的SI5324需要通過I2C配置，官網(wǎng)找了一圈，只有VC709和KC705的例程，都是基于MICROBLAZE的，改到ZC706上問題也不大，準(zhǔn)備動手這際，轉(zhuǎn)念一想，何不
2019-07-05 08:22:37
C138和C141之后測量信號的差異。不幸的是，我沒有在Si5324的引腳29和28上看到任何時鐘輸出，在衰減抖動之后，應(yīng)該將我的125 MHz反饋回FPGA和SFP IP。我的設(shè)計很簡單。它由1G eth
2019-09-27 09:21:26
MHz的雙時鐘輸入，并產(chǎn)生兩個相等的倍頻時鐘輸出，范圍為8 kHz至644.53 MHz。輸入時鐘頻率和時鐘倍頻比可從流行的SyncE和T1 / E1速率表中選擇。 Si5315基于第三代DSPLL技術(shù)，可在高度集成的PLL解決方案中提供任意速率頻率合成和抖動衰減，無需外部VCXO和環(huán)路濾波器組件
2019-02-26 09:34:20
各種抖動技術(shù)規(guī)范是什么抖動的影響有哪些
2021-04-06 09:22:00
Si5328-EVB，評估套件為評估Si5328任意頻率精密時鐘定時IC提供了一個平臺。 Si5328由微處理器或MCU（微控制器單元）通過I2C或SPI接口控制。 Si5328是一款抖動衰減器
2019-01-30 15:30:20
SI5340-D-EVB，評估板用于評估Si5340任意頻率，任意輸出，抖動衰減時鐘倍頻器版本D.器件版本以白色1英寸x 0.187英寸標(biāo)簽與文本SI5340-D區(qū)分-EB安裝在主板的左下角。 （僅用于訂購目的，術(shù)語EB和EVB分別指板和套件
2019-02-26 09:33:59
SI5340-EVB，評估板用于評估Si5340低抖動任意頻率時鐘發(fā)生器。 Si5340采用獲得專利的Multisynth技術(shù)，可產(chǎn)生多達10個獨立時鐘頻率，每個頻率具有0 ppm的合成誤差
2019-02-26 09:28:56
SI5341-D-EVB，評估板用于評估Si5341任意頻率，任意輸出，抖動衰減時鐘倍頻器版本D.器件版本以白色1英寸x 0.187英寸標(biāo)簽與文本SI5341-D區(qū)分-EB安裝在主板的左下角。 （僅用于訂購目的，術(shù)語EB和EVB分別指板和套件
2019-02-26 09:41:06
SI5341-EVB，評估板用于評估Si5341低抖動任意頻率時鐘發(fā)生器。 Si5341采用獲得專利的Multisynth技術(shù)，可產(chǎn)生多達10個獨立時鐘頻率，每個頻率具有0 ppm的合成誤差
2019-02-25 07:03:01
SI5342-D-EVB，評估板用于評估Si5342任意頻率，任意輸出，抖動衰減時鐘倍頻器版本D.器件版本以白色1英寸x 0.187英寸標(biāo)簽與文本SI5342-D區(qū)分-EB安裝在主板的左下角。 （僅用于訂購目的，術(shù)語EB和EVB分別指板和套件
2019-02-25 09:42:36
SI5344-D-EVB，基于Si5344任意頻率，任意輸出，抖動衰減時鐘倍頻器Rev.D的評估板
2019-02-25 06:21:54
SI5344-EVB，評估板用于評估Si5344任意頻率，任意輸出，抖動衰減時鐘倍頻器。 Si5344結(jié)合了第四代DSPLL和Multisynth技術(shù)，可為需要最高抖動性能的應(yīng)用提供任意頻率時鐘
2019-02-26 09:36:27
SI5345-D-EVB，評估板用于評估Si5345任意頻率，任意輸出，抖動衰減時鐘倍頻器版本D.器件版本以白色1英寸x 0.187英寸標(biāo)簽與文本SI5345-D區(qū)分-EB安裝在主板的左下角。 （僅用于訂購目的，術(shù)語EB和EVB分別指板和套件
2019-02-25 09:46:14
SI5345-EVB，評估板用于評估Si5345任意頻率，任意輸出，抖動衰減時鐘倍頻器。 Si5345結(jié)合了第四代DSPLL和Multisynth技術(shù)，可為需要最高抖動性能的應(yīng)用生成任意頻率時鐘
2019-02-26 07:34:30
SI5346-D-EVB，評估板用于評估Si5346任意頻率，任意輸出，抖動衰減時鐘倍頻器版本D.器件版本以白色1英寸x 0.187英寸標(biāo)簽與文本SI5346-D區(qū)分-EB安裝在主板的左下角。 （僅用于訂購目的，術(shù)語EB和EVB分別指板和套件
2019-02-25 09:51:02
具有可編程的抖動衰減帶寬。 SI5348-D-EVB通過板載SMA連接器支持三個獨立的差分輸入時鐘，兩個獨立的CMOS輸入時鐘和七個獨立的輸出時鐘。 Si5348-D-EVB可以通過USB連接控制
2019-02-25 09:56:55
本文針對全方位的信號路徑系統(tǒng)中的高速全差分運放及高頻寬14位模擬/數(shù)字轉(zhuǎn)換器的隨機及固定時鐘抖動，具體分析、研究了超低噪聲兼時鐘抖動濾除技術(shù)。研究選用雙級聯(lián)PLLatinum架構(gòu)，配置高性能壓控振蕩器(VCXO)，很好地實現(xiàn)了降噪和時鐘抖動濾除的作用。
2019-07-05 07:47:46
板上沒有此頻率的輸入。我主要看兩個選擇： - 通過FPGA內(nèi)的MMCM生成這個時鐘（我讀過它不是個好主意） - 使用電路板上的SI5324抖動衰減器產(chǎn)生312.5MHZ頻率在kc705的原理圖中，我
2019-09-27 09:51:28
。振蕩器連接到引腳AK34和AL34（振蕩器具有差分輸出）。3.我需要將引腳AK34和AL34（156,25MHz振蕩器）連接到引腳AW32和AW33（輸入到抖動衰減器Si5324）。在這里我遇到了第一個
2019-09-25 11:45:13
你好;我正在使用VC709評估板。我想使用SI5324作為抖動衰減器。我使用DSPLLsim軟件計算SI5324寄存器值。我想要的時鐘是122.88MHz，但Si5324產(chǎn)生119.4 MHz。我
2019-10-18 09:36:35
theclock_control_program.vhd中有rom來存儲配置si5324的程序，而si5324_clock_setup.psm是定義了si5324寄存器值的代碼。我想知道在更改寄存器值insi5324_clock_setup.psm后如何獲得newclock_control_program.vhd / .v。謝謝。
2019-09-26 10:32:19
在下小白一枚，花了一個多月的時間用FPGA控制SI5324C實現(xiàn)了時鐘的分頻，輸入50M輸出25M，當(dāng)然了，這用MMCM或者PLL也能實現(xiàn)，但是SI5324C有一些特別的好處。程序在附件里
2017-11-24 20:31:36
Si539x芯片配置步驟第一次寫博客(學(xué)習(xí)筆記)，同時記錄一次Si5394時鐘芯片的配置，寫這個教程的原因也是因為自己在網(wǎng)上搜資料的時候，用的人少之又少，讓后面用到的人少走些彎路吧。前3點為芯片
2021-12-08 07:54:06
SI5342-EVB，評估板用于評估Si5342任意頻率，任意輸出，抖動衰減時鐘倍頻器。 Si5342結(jié)合了第四代DSPLL和Multisynth技術(shù)，可為需要最高抖動性能的應(yīng)用生成任意頻率時鐘。可以使用Clock Builder Pro（CB Pro）軟件工具控制和配置Si5342-EVB
2019-02-27 11:28:29
SI5346-EVB，評估板用于評估Si5346任意頻率，任意輸出，抖動衰減時鐘倍頻器。 Si5346在單個IC中包含2個獨立的DSPLL，每個DSPLL具有可編程的抖動衰減帶寬
2019-02-28 08:17:47
SI5347-EVB，評估板用于評估Si5347四路任意頻率抖動衰減時鐘倍頻器。 Si5347在單個IC中包含4個獨立的DSPLL，每個DSPLL具有可編程的抖動衰減帶寬。 Si5347-EVB通過
2019-02-27 11:19:26
一塊音視頻處理芯片輸出1080i的數(shù)據(jù)Data及其同步時鐘Clk，但是時鐘clk的抖動很大，我該如何處理呢？另外，抖動很大的時鐘源能否在后面接入一個模擬鎖相環(huán)降低時鐘的抖動呢？
2018-11-12 09:12:43
時鐘抖動或結(jié)束時鐘抖動的最佳方法是什么？
2021-03-17 07:04:07
我正在為clk_stm1~155.52MHz的SFP stm1輸入計時我的GTX，這是從Si570到Si5324再到GTX模塊我不確定這個clk的ppm，它可能會關(guān)閉多少...... Si
2019-09-23 06:44:53
隨著數(shù)據(jù)速率的提高，時鐘抖動分析的需求也在與日俱增。在高速串行數(shù)據(jù)鏈路中，時鐘抖動會影響發(fā)射機、傳輸線和接收機的數(shù)據(jù)抖動。保證時鐘質(zhì)量的測量也在不斷發(fā)展
2008-12-27 12:24:05
6 隨著數(shù)據(jù)速率的提高，時鐘抖動分析的需求也在與日俱增。在高速串行數(shù)據(jù)鏈路中，時鐘抖動會影響發(fā)射機、傳輸線和接收機的數(shù)據(jù)抖動。保證時鐘質(zhì)量的測量也在不斷發(fā)展。目前
2009-07-07 14:01:2120 本文主要討論采樣時鐘抖動對ADC 信噪比性能的影響以及低抖動采樣時鐘電路的設(shè)計。
2009-11-27 11:24:0715 MAX3625B是一款低抖動、精密時鐘發(fā)生器，優(yōu)化用于網(wǎng)絡(luò)設(shè)備。器件內(nèi)置晶體振蕩器和鎖相環(huán)(PLL)時鐘倍頻器，以產(chǎn)生高頻時鐘輸出，用于以太網(wǎng)、10G光纖通道及其它網(wǎng)絡(luò)設(shè)備。Ma
2010-03-01 08:54:52126 高速互聯(lián)鏈路中參考時鐘的抖動分析與測量
在高速互聯(lián)鏈路中，發(fā)送器的參考工作時鐘的抖動是影響整個
2010-04-15 14:01:3919 該應(yīng)用筆記提出了超低抖動時鐘合成器的一種設(shè)計思路，其目標(biāo)是產(chǎn)生2GHz時鐘時，邊沿之間的抖動< 100fs。分析和仿真結(jié)果表明，要達到這一抖動指標(biāo)，設(shè)計難度遠遠高于預(yù)期。關(guān)
2009-04-21 23:14:05723 
摘要：該應(yīng)用筆記提出了超低抖動時鐘合成器的一種設(shè)計思路，其目標(biāo)是產(chǎn)生2GHz時鐘時，邊沿之間的抖動< 100fs。分析和仿真結(jié)果表明，要達到這一抖動指標(biāo)，設(shè)計難度遠遠高于預(yù)
2009-04-22 09:35:13296 
摘要：這是一篇關(guān)于時鐘(CLK)信號質(zhì)量的應(yīng)用筆記，介紹如何測量抖動和相位噪聲，包括周期抖動、逐周期抖動和累加抖動。本文還描述了周期抖動和相位噪聲譜之間的關(guān)系，并介紹
2009-04-22 10:16:503736 
摘要：該應(yīng)用筆記提出了超低抖動時鐘合成器的一種設(shè)計思路，其目標(biāo)是產(chǎn)生2GHz時鐘時，邊沿之間的抖動< 100fs。分析和仿真結(jié)果表明，要達到這一抖動指標(biāo)，設(shè)計難度遠遠高于預(yù)
2009-04-25 09:54:26482 
摘要：該應(yīng)用筆記提出了超低抖動時鐘合成器的一種設(shè)計思路，其目標(biāo)是產(chǎn)生2GHz時鐘時，邊沿之間的抖動< 100fs。分析和仿真結(jié)果表明，要達到這一抖動指標(biāo)，設(shè)計難度遠遠高于預(yù)
2009-05-08 10:19:03431 
MAX3625A 低抖動、精密時鐘發(fā)生器，提供三路輸出
2009-08-13 13:01:27828 
MAX3624 低抖動、精密時鐘發(fā)生器，提供四路輸出
概述
MAX3624是一款低抖動精密
2009-09-18 08:56:41682 
理解不同類型的時鐘抖動
抖動定義為信號距離其理想位置的偏離。本文將重點研究時鐘抖動，并探討下面幾種類型的時鐘抖動：相鄰周期抖動、周期抖動、時間間隔誤
2010-01-06 11:48:111608 
MAX3625B 抖動僅為0.36ps的PLL時鐘發(fā)生器
概述
MAX3625B是一款低抖動、精密時鐘發(fā)生器，優(yōu)化用于網(wǎng)絡(luò)設(shè)備。器件內(nèi)置晶體振蕩器和鎖相環(huán)(PLL)
2010-03-01 08:56:181345 
Si5374和Si5375是業(yè)界第一款集成了四個獨立高性能鎖相回路(PLL)的單芯片時鐘IC，它所提供的PLL集成是其它競爭解決方案的兩倍，抖動則低了40%。
2011-05-18 09:39:472225 
時鐘抖動時域分析(下):
2012-05-08 15:26:2529 介紹 此應(yīng)用筆記側(cè)重于不同類型的時鐘抖動。時鐘抖動是從它的時鐘邊沿偏差理想的位置。了解時鐘抖動非常重要在應(yīng)用中，因為它起著關(guān)鍵作用，在時間預(yù)算一個系統(tǒng)。 隨著系統(tǒng)數(shù)據(jù)速率的增加，定時抖動成為關(guān)鍵
2017-04-01 16:13:186 時鐘抖動時域分析，第 2 部分
2017-10-26 16:10:426 時鐘抖動時域分析 第 3 部分
2017-10-26 16:13:284 時間域中分析的時鐘抖動，第 1 部分
2017-10-26 16:16:234 隨著SERDES應(yīng)用越來越多，速率也越來越高，SI的問題漸漸變得越來越重要，它對PCB設(shè)計，SERDES參數(shù)優(yōu)化都有著非常重要的指導(dǎo)作用。而器件選型也往往以SI仿真開始。但是在仿真時，工具會讓用戶
2017-11-18 13:17:014726 
本文針對全方位的信號路徑系統(tǒng)中的高速全差分運放及高頻寬14位模擬/數(shù)字轉(zhuǎn)換器的隨機及固定時鐘抖動，具體分析、研究了超低噪聲兼時鐘抖動濾除技術(shù)。
2018-05-30 09:00:005165 
這些抖動衰減時鐘倍增器結(jié)合了第四代DSPLL?和Multisynth?技術(shù)，為需要最高抖動性能的應(yīng)用程序?qū)崿F(xiàn)任何頻率時鐘生成和抖動衰減。這些設(shè)備可通過一個串行接口進行編程，該接口具有電路內(nèi)可編程
2019-07-01 08:00:0020 的Multisynth?技術(shù)，可產(chǎn)生四個精度為0 ppm的獨立時鐘。每個輸出時鐘可獨立配置，以支持各種信號格式和電源電壓。si5338在節(jié)省空間的4x 4 mm qfn封裝中提供低抖動頻率合成。該設(shè)備可通過與I2C/SMBus兼容的串行接口編程，并支持1.8、2.5或3.3V核心電源的操作。
2019-10-29 08:00:000 本文針對全方位的信號路徑系統(tǒng)中的高速全差分運放及高頻寬14位模擬/數(shù)字轉(zhuǎn)換器的隨機及固定時鐘抖動，具體分析、研究了超低噪聲兼時鐘抖動濾除技術(shù)。研究選用雙級聯(lián)PLLatinum架構(gòu)，配置高性能壓控振蕩器（VCXO），很好地實現(xiàn)了降噪和時鐘抖動濾除的作用。
2020-09-23 10:45:002 電子發(fā)燒友網(wǎng)站提供《SI5324 時脈產(chǎn)生器參考設(shè)計.pdf》資料免費下載
2020-12-31 05:33:4112 AD5324 Evaluation Software
2021-02-20 10:55:146 前言 ：本文我們介紹下ADC采樣時鐘的抖動（Jitter）參數(shù)對ADC采樣的影響，主要介紹以下內(nèi)容： 時鐘抖動的構(gòu)成 時鐘抖動對ADC SNR的影響 如何計算時鐘抖動 如何優(yōu)化時鐘抖動 1.采樣理論
2021-04-07 16:43:457378 
AD5324評估軟件
2021-04-09 16:41:4711 超低抖動時鐘的產(chǎn)生與分配
2021-04-18 14:13:518 ADC時鐘接口中的最小抖動
2021-05-09 12:19:406 AD5324評估軟件
2021-05-30 12:56:255 ADL5324 S參數(shù)
2021-06-11 10:11:581 電子發(fā)燒友網(wǎng)為你提供ADI(ti)EVAL-AD5324相關(guān)產(chǎn)品參數(shù)、數(shù)據(jù)手冊，更有EVAL-AD5324的引腳圖、接線圖、封裝手冊、中文資料、英文資料，EVAL-AD5324真值表，EVAL-AD5324管腳等資料，希望可以幫助到廣大的電子工程師們。
2021-08-17 00:00:04
Si539x芯片配置步驟第一次寫博客(學(xué)習(xí)筆記)，同時記錄一次Si5394時鐘芯片的配置，寫這個教程的原因也是因為自己在網(wǎng)上搜資料的時候，用的人少之又少，讓后面用到的人少走些彎路吧。前3點為芯片
2021-11-25 20:21:0318 KOYUELEC光與電子提供技術(shù)支持，有容微電子GM50101：超低附加抖動時鐘緩沖器。
2022-05-07 11:40:151071 時鐘抖動使隨機抖動和相位噪聲不再神秘
2022-11-07 08:07:294 時鐘抖動解秘—高速鏈路時鐘抖動規(guī)范基礎(chǔ)知識
2022-11-07 08:07:301 1.1.1.??抖動定義和分類 ITU-T G.701對抖動的定義為：“抖動是指數(shù)字信號在短期內(nèi)相對于理想位置發(fā)生的偏移重大影響的短時變化”。 對于真實物理世界中的時鐘源，比如晶振、DLL、PLL，它們的時鐘輸出周期都不可能是一個單點的固定值，而是隨時間而變化的
2023-03-10 14:54:32657 
系統(tǒng)時序設(shè)計中對時鐘信號的要求是非常嚴(yán)格的，因為我們所有的時序計算都是以恒定的時鐘信號為基準(zhǔn)。但實際中時鐘信號往往不可能總是那么完美，會出現(xiàn)抖動(Jitter)和偏移（Skew）問題。
2023-04-04 09:20:561637 首先，我們需要理解什么是時鐘抖動。簡而言之，時鐘抖動（Jitter）反映的是時鐘源在時鐘邊沿的不確定性（Clock Uncertainty）。
2023-06-02 09:09:061026 
先來聊一聊什么是時鐘抖動。時鐘抖動實際上是相比于理想時鐘的時鐘邊沿位置，實際時鐘的時鐘邊沿的偏差，偏差越大，抖動越大。實際上，時鐘源例如PLL是無法產(chǎn)生一個絕對干凈的時鐘。這就意味著時鐘邊沿出現(xiàn)在
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本文主要介紹了時鐘偏差和時鐘抖動。
2023-07-04 14:38:28960 
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