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電子發燒友網>模擬技術>基于連續時間、?-Σ高速ADC的寬帶模擬前端可降低功耗

基于連續時間、?-Σ高速ADC的寬帶模擬前端可降低功耗

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2021-04-21 11:21:006

AD7817/AD7818:雙路低功耗CMOS模擬前端,帶DSP微機數據表

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2021-04-22 09:48:047

AD73322:低成本、低功耗CMOS通用雙模擬前端數據表

AD73322:低成本、低功耗CMOS通用雙模擬前端數據表
2021-05-11 08:42:076

AD73311L:低成本、低功耗CMOS通用模擬前端數據表

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2021-05-17 08:52:273

AD73411:帶DSP單片機數據表的低功耗CMOS模擬前端

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2021-05-17 10:47:382

AD73322L:低成本、低功耗CMOS通用雙模擬前端數據表

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2021-05-17 12:09:119

低功耗、16位雙/單ADC

低功耗、16位雙/單ADC
2021-05-25 17:25:0010

一款12位高速、低功耗的逐次逼近型ADC

AD7274是一款12位高速、低功耗的逐次逼近型ADC。工作電壓為:2.35V至3.6 V單電源,最高呑吐量可達3 MSPS。
2022-10-13 17:11:491566

使用SAR ADC構建低功耗精密信號鏈應用最重要的時序因素有哪些?

本文介紹低功耗系統在降低功耗的同時保持精度時,所涉及的信號鏈在模擬前端時序、ADC時序和數字接口時序的時序因素和解決方案,以滿足測量和監控應用的要求,本文主要說明當所選ADC是逐次逼近寄存器(SAR
2022-11-23 20:15:12552

模擬前端時序、ADC時序和數字接口時序中的信號鏈考慮因素

本文介紹了在低功耗系統中降低功耗同時保持測量和監控應用所需的精度的時序因素和解決方案。它解釋了當所選ADC是逐次逼近寄存器(SAR)ADC時影響時序的因素。對于Σ-Δ(∑-Δ)架構,時序考慮因素有所不同(請參閱本系列文章的第1部分)。本文探討了模擬前端時序、ADC時序和數字接口時序中的信號鏈考慮因素。
2022-12-13 11:20:181057

模擬電源設計中降低功耗

Nano,Nano:在模擬電源設計中降低功耗
2023-01-05 09:43:45421

于連續時間、?-Σ高速ADC寬帶模擬前端技術分析

連續時間?-Σ (CTDS) 模數轉換器 (ADC) 是音頻系統、電話聽筒和移動電子產品的首選架構。這種ADC架構可實現高效集成、減少信號鏈和低功耗等優勢。當高動態范圍和功率效率是主要要求
2023-01-09 15:26:43741

FreeRTOS如何降低功耗

1、如何降低功耗? 一般的簡單應用中處理器大量的時間都在處理空閑任務,所以我們就可以考慮當處理器處理空閑任務的時候就進入低功耗模式,當需要處理應用層代碼的時候就將處理器從低功耗模式喚醒
2023-07-30 11:18:36628

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