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電子發燒友網>MEMS/傳感技術>Calculating the tachometer reg

Calculating the tachometer reg

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systemverilog:logic比reg更有優勢

在systemverilog協議中,logic定義四態值,即向量(vector)的每個位(bit)可以是邏輯0, 1, Z或X,與verilog協議中的reg很接近。但是logic有個很明顯的優勢,不允許多驅動。
2023-10-26 09:32:24324

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