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基于SHA-1算法的硬件設(shè)計(jì)及實(shí)現(xiàn)(FPGA實(shí)現(xiàn))

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  SHA-1(Secure Hash Algorithm)是一種非常流行的安全散列算法,為了滿足各種應(yīng)用對(duì)SHA-1算法計(jì)算速度的需要,該文圍繞Hash 函數(shù),基于本課題組的密文取情平臺(tái),對(duì)SHA-1算法進(jìn)行深入研究,面向Xilinx K7 410T FPGA 芯片設(shè)計(jì)SHA-1算法實(shí)現(xiàn)結(jié)構(gòu),完成SHA-1算法編程,進(jìn)行測(cè)試和后續(xù)應(yīng)用。該算法在FPGA 上實(shí)現(xiàn),可以實(shí)現(xiàn)3.2G bit/s的吞吐率,最大時(shí)鐘頻率為95 MHZ。仿真結(jié)果表明,與其它硬件設(shè)計(jì)相比,該算法在不影響原算法的安全的基礎(chǔ)上可以獲得更高的運(yùn)行速度和吞吐量。

基于SHA-1算法的硬件設(shè)計(jì)及實(shí)現(xiàn)(FPGA實(shí)現(xiàn))

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