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小數乘法器的低功耗設計與實現

大小:0.46 MB 人氣: 2018-03-06 需要積分:1

  提出一種針對小數乘法器的低功耗設計算法,其優化指標為綜合后小數乘法器內部寄存中間運算結果的寄存器位寬,解決了目前低功耗設計中算法自身邏輯單元被引入系統從而降低系統優化效果的問題。該算法能夠在不降低系統工作效率、不損失系統運算精度、不增加額外邏輯單元的條件下,大幅降低系統功耗和面積。在使用該算法對某一射頻模塊進行優化后,硬件測試結果顯示該射頻模塊對某型號FPGA的邏輯占用率相比優化前降低17. 9%,寄存器總數降低30. 7%,存儲單元占用率降低21. 5%。該算法適用于對含有大量小數乘法運算的系統進行低功耗優化。

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