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Xilinx推出了新一代功耗評估工具:PDM

FPGA技術驛站 ? 來源:FPGA技術驛站 ? 作者:FPGA技術驛站 ? 2022-10-27 13:34 ? 次閱讀

在發布Vivado 2022.2的同時,Xilinx推出了新一代功耗評估工具:PDM(Power Designer Manager)。這里我們首先介紹一下它與XPE(Xilinx Power Estimator)的主要差異。

XPE可支持Xilinx所有芯片型號,而PDM目前僅支持Versal和Kria SOM產品

XPE是一個Excel文件,而PDM是一個獨立軟件,需要單獨下載單獨安裝。

(注:PDM并非集成在Vivado中)

因此,對于UltraScale或UltraScale+芯片,仍然需要采用XPE進行功耗評估。

PDM既提供Windows版也提供Linux版,下載鏈接如下:

https://www.xilinx.com/products/design-tools/power-design-manager.html

接下來我們再來看看PDM的一些特色:

針對Versal ACAP中的硬核如DDR控制器等提供設置界面,以實現更為精確的功耗評估。

提供輸入時鐘(來自內部或外部)設置界面。

提供BRAM/URAM/DSP工作模式設置。

PDM使用流程:

PDM支持兩種使用流程:手工流程和導入流程。手工流程要求工程師手動輸入各種參數,如時鐘頻率、翻轉率、各類資源使用量以及使用模式等。導入模式可直接導入.xpe文件用于功耗評估。

手工流程需要先創建PDM工程,然后填入具體芯片型號,如下圖所示。

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創建好PDM工程之后會顯示如下界面。總體而言,這個界面由4部分構成:各類資源評估欄、整體功耗顯示界面、環境參數設置界面和各類資源功耗顯示界面。

230c86fc-55ae-11ed-a3b6-dac502259ad0.png

如果要評估PL部分的功耗,可先進行時鐘設置。PDM提供了時鐘設置功能,如下圖所示,點擊Estimation下的Clock,右側界面隨之出現Create Clock選項。

23b9aa12-55ae-11ed-a3b6-dac502259ad0.png

點擊Create Clock,會彈出如下界面。在這個界面我們可以設置源時鐘、時鐘生成模塊(MMCM還是PLL)以及生成時鐘。

23d3525a-55ae-11ed-a3b6-dac502259ad0.png

Logic部分用于評估CLB內資源的功耗,包括LUT(查找表)和FF(觸發器)。對于LUT,PDM分為三類處理:組合邏輯、移位寄存器和分布式RAM(后兩者針對SLICEM中的LUT)。如果僅僅知道分布式RAM的大小(深度和寬度),可借助下圖中的紅色方框準確得出所消耗LUTRAM的個數。

2428a6f6-55ae-11ed-a3b6-dac502259ad0.png

2449df74-55ae-11ed-a3b6-dac502259ad0.png

具體使用時,建議將這三種LUT分開填寫,這樣可以清楚地看到每類LUT的功耗,同時對于不同時鐘域下的LUT也要分開寫,如下圖所示。

246296cc-55ae-11ed-a3b6-dac502259ad0.png

對于Block RAM,選中BlockRAM之后,。會顯示Add Block Memory選項,如下圖中的紅色方框所示。可借助此選項更準確地得出BRAM的功耗。

2470729c-55ae-11ed-a3b6-dac502259ad0.png

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對于DSP,PDM提供了詳細的設置界面,如下圖所示。在這個界面上,可以填寫DSP的工作模式、時鐘頻率、是否使用了乘法器等。

24d42878-55ae-11ed-a3b6-dac502259ad0.png

對于URAM,可進行級聯個數設置、Latency設置、工作模式設置、工作頻率設置等,如下圖所示。

24fd499c-55ae-11ed-a3b6-dac502259ad0.png

此外,我們還可以進行其他部分的功耗評估,如PS、AIE、NoC、DDR控制器等硬核。

審核編輯 :李倩

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原文標題:新一代功耗評估工具PDM

文章出處:【微信號:Lauren_FPGA,微信公眾號:FPGA技術驛站】歡迎添加關注!文章轉載請注明出處。

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