作為IC設(shè)計人員，熟練掌握數(shù)字前端語法檢查工具Spyglass的重要性不言而喻，本文手把手教你學(xué)習(xí)Spyglass工具。

啟動Spyglass軟件：spyglass &

點(diǎn)擊左邊Add File(s):

將.v文件通過rtl.f統(tǒng)一添加，如下圖，點(diǎn)擊OK：

或者通過命令添加：

sg_shell> read_file -type sourcelist rtl.f

設(shè)置頂層，選中下圖左邊Set Options，手動設(shè)置Value為digital_top.v，這里我們留一個bug，后面看得到。

或者通過命令添加：

sg_shell> set_option top digital_top.v

我們也可以默認(rèn)缺省頂層文件，此處，我們暫時不用remove_option top命令，注意剛才我們留了一個bug。

sg_shell> remove_option top

點(diǎn)擊Read Design，

選擇SynthesizeNetlist，在讀入設(shè)計的同時進(jìn)行綜合

點(diǎn)擊Run Design Read:

讀取完成發(fā)現(xiàn)：

top 'digital_top.v' : Design unit not found in the design

bug來了，什么問題呢？找不到Design unit, 聰明的你一定發(fā)現(xiàn)了，頂層是module名，不是module文件名。如下圖所示：

也就是說設(shè)置Top level Design Unit的value為DIGITAL_TOP, 而不是digital_top.v。

再次Run Read Design，如下圖，讀取成功。

接著，設(shè)置Goal Setup：

首先選中l(wèi)int，我們先看lint, 點(diǎn)擊Run Goal：

運(yùn)行得到結(jié)果如下，我們開始逐一解析錯誤的原因，并給出RTL修改辦法，具體參見小編知識星球。

審核編輯：湯梓紅