易靈思提供了原語文檔,可以查看每個原語。經(jīng)常有人會問,如果普通的GPIO怎么走全局時鐘網(wǎng)絡(luò),其實很簡單,打開原主文檔,找到EFX_GBUFCE,該部分提供了verilog和VHDL的用法。
EFX_GBUFCE既可以讓GPIO走全局時鐘網(wǎng)絡(luò)也可以用于為時鐘添加使能控制,當(dāng)并不是隨時需要該時鐘時可以把時鐘禁止以節(jié)省功耗。
CE_POLARITY用于指示CE是高有效還是低有效,如果為1則高有效,反之則低有效。
CE是時鐘O的輸出使能。
EFX_GBUFCE # (
.CE_POLARITY(1'b1) // 0 active low, 1 active high
) EFX_GBUFCE_inst (
.O(O), // Clock output to global clock network
.I(I), // Clock input
.CE(CE) // Clock gate
);
審核編輯:劉清
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GPIO
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時鐘網(wǎng)絡(luò)
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VHDL電路
原文標(biāo)題:GBUFCE原語
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