利用for循環實現對信號的賦值。
如下案例中,func_id_vld為512bit,需要根據func_mode_in[1024-1:0]給func_id_vld賦值,func_mode_in每2個bit對應一個func_id_vld,即func_mode_in[1:0]對應func_id_vld[0],func_mode_in[3:2]對應func_id_vld[1],func_mode_in[1023:1022]對應func_id_vld[511], 賦值規則為func_mode_in[1:0]為2‘b01時,func_id_vld[0]為1,以此類推。
采用for(int*)類型格式,可以在一個else分支中使用,不需要使用generate,使用更加靈活,使用范圍更廣。
always@(posedge clk) if(~rst_n) begin func_id_vld <= 512'b0 ; end else begin for(int i=0; i<512;i=i+1) begin : func_id_vld_gen func_id_vld[i] <= (func_mode_in[2*i+:2]==2'b01) ; end end
2、采用for(int*)實現同一個信號賦值的循環
下圖所示,采用for(int*)類型格式實現了一個16mux1的循環賦值語句,實現不同條件一下,對debug_test_16mux1的賦值操作,即16mux1的邏輯。
always@(*) begin debug_test_16mux1 = 128'd0; for(int i=0; i<16;i=i+1) begin : debug_test_16mux1_gen if(cfg_16mux1_mode ==i) begin debug_test_16mux1 = debug_test_in[128*i+:128] ; break ; end end end
always@(*) begin case(cfg_16mux1_mode) 0 : debug_test_16mux1 = debug_test_in[127 :0 ]; 1 : debug_test_16mux1 = debug_test_in[255 :128 ]; 2 : debug_test_16mux1 = debug_test_in[383 :256 ]; 3 : debug_test_16mux1 = debug_test_in[511 :384 ]; 4 : debug_test_16mux1 = debug_test_in[639 :512 ]; 5 : debug_test_16mux1 = debug_test_in[767 :640 ]; 6 : debug_test_16mux1 = debug_test_in[895 :768 ]; 7 : debug_test_16mux1 = debug_test_in[1023 :896 ]; 8 : debug_test_16mux1 = debug_test_in[1151 :1024 ]; 9 : debug_test_16mux1 = debug_test_in[1279 :1152 ]; 10: debug_test_16mux1 = debug_test_in[1407 :1280 ]; 11: debug_test_16mux1 = debug_test_in[1535 :1408 ]; 12: debug_test_16mux1 = debug_test_in[1663 :1536 ]; 13: debug_test_16mux1 = debug_test_in[1791 :1664 ]; 14: debug_test_16mux1 = debug_test_in[1919 :1792 ]; 15: debug_test_16mux1 = debug_test_in ; endcase end
NOTE:在for(int*)語句中,如果寫成debug_test_16mux1 = debug_test_in[128*i+127:128*i] , VCS會報語法錯誤;只寫成debug_test_16mux1 =debug_test_in[128*i+:128],此處需要注意。
審核編輯:劉清
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原文標題:verilog語法:幾種可綜合的for循環語句
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