數字前中后端都不得不熟練的clock switch設計
本章節講解數字前中后端都不得不熟練的clock switch設計。
芯片運行過程中需要時鐘切換時，要考慮到是否會產生glitch，小小的glitch有可能導致電路運行的錯誤。所以時鐘切換時需要特別的處理。
直接使用MUX進行時鐘切換或者采用如下電路結構進行時鐘切換：
assignoutclock=select?clk1:clk0;assignoutclock= (clk1 & select) | (~select & clk0);
兩種做法都會產生時鐘切換毛刺的，芯片系統很容易進入亞穩態的情況。
為了解決時鐘切換的毛刺問題，對于時鐘源分為同步和異步的情況，分為如下兩種解決方案：
CLK0與CLK1為同步時鐘源，即CLK0與CLK1成整數倍關系
插入下降沿觸發的D觸發器，當前已打開的時鐘路徑上的時鐘會在其下降沿之后先關閉，然后待打開時鐘路徑上的時鐘在其下降沿之后即打開。
如下所示：從下圖第二個箭頭開始，實際發生時鐘切換。
那么，請問CLK0與CLK1為異步時鐘時，電路如何設計？
審核編輯：劉清
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原文標題：不得不熟練的clock switch?設計
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