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Efinity Interface Designer報(bào)錯(cuò)案例-v1

XL FPGA技術(shù)交流 ? 來(lái)源:易靈思FPGA技術(shù)交流 ? 作者:易靈思FPGA技術(shù)交流 ? 2023-12-12 09:52 ? 次閱讀

(1)ERROR:Interface Designer constraint generation was not successfull,will not proceed to efx_pnr...

13d2db7e-9891-11ee-be60-92fbcf53809c.png

原因:(1)有些客戶使用Win7版本,目前Efinity對(duì)Win7的支持不好。建議升級(jí)成win10。

(2)殺毒軟件刪除了文件,實(shí)際interface生成約束是沒(méi)有問(wèn)題的,客戶pnr的時(shí)候就報(bào)錯(cuò),需要重新安裝軟件。

(3)電腦存在加密系統(tǒng) 。造成的現(xiàn)象是新建工程時(shí)interface可以打開(kāi),但是生成xxx.peri.xml文件之后再次打開(kāi)就會(huì)報(bào)錯(cuò)。

(2)Interface打不開(kāi)。

現(xiàn)象:(1)打開(kāi)interface的時(shí)候指示: Efinity Interface Designer finished. Exit code = 1 Exit status : Normal Interface design file exists, check and migrate done 13e3bfde-9891-11ee-be60-92fbcf53809c.png (2)新建工程第一次可以打開(kāi)interface Designer (3)刪除xxx.peri.xml之后,第一次也可以打開(kāi)Interface Designer. 原因:電腦存在加密 ? (3) interface打不開(kāi) 打開(kāi)interface Designer時(shí)會(huì)報(bào)以下錯(cuò)誤。 EfinityIPCatalogfinished.Exit code = 0Exit status:Normal

13fc2394-9891-11ee-be60-92fbcf53809c.jpg

編譯過(guò)程可能報(bào)以下錯(cuò)誤:

ERROR: Interface Designer constraint generation was not successful, will not processpnr..

1417637a-9891-11ee-be60-92fbcf53809c.png

解決方案:安裝VC_redist.x64.exe,注意參考軟件安裝指導(dǎo)的版本。

(4)repeated,non-bussed pin found in verilog template generation:clk_27m

144378fc-9891-11ee-be60-92fbcf53809c.png

說(shuō)明:在GPIO處定義了一個(gè)clk_27m,在pll的輸出上又定義了一個(gè)clk_27m,兩個(gè)信號(hào)名沖突。

(5)ERROR: Interface Designer constraint generation was not successful, will not processpnr..

145f906e-9891-11ee-be60-92fbcf53809c.png

原因:1)一般是軟件有360或者別的殺毒軟件的相關(guān)文件刪除了,需要找回文件或者重新安裝軟件。

2)客戶使用Win7版本,目前Efinity對(duì)Win7的支持不好。建議升級(jí)成win10。

(6)cannot connect to more than 4 different clocks per region on left and right

14aa7dd6-9891-11ee-be60-92fbcf53809c.png

14bb30f4-9891-11ee-be60-92fbcf53809c.png

原因是在pinout文件中對(duì)應(yīng)的Clock Region中,不能超過(guò)4個(gè)時(shí)鐘去驅(qū)動(dòng)。

也就是GPIOR_PN_42,41,40三組差分對(duì),不能由兩組LVDS來(lái)驅(qū)動(dòng),因?yàn)槊拷MLVDS時(shí)鐘有l(wèi)vds_fast_clk和lvds_slow_clk兩個(gè),兩組就會(huì)有4個(gè)時(shí)鐘在Region clock R13區(qū)域。

結(jié)論就是把LVDS差分對(duì)放在同一個(gè)Clock Region.

(7)Resource name is empty

14d3f30a-9891-11ee-be60-92fbcf53809c.png

解決方案:Resource是指管腳,這里是指沒(méi)有分配管腳。

(8)用新版本軟件打開(kāi)老版本工程時(shí)interface Desinger打不開(kāi)

14eddea0-9891-11ee-be60-92fbcf53809c.jpg


發(fā)給客戶的peri.xml,客戶打不開(kāi)有問(wèn)題,叫他們文本打開(kāi)peri看看,有些客戶沒(méi)有動(dòng)peri文件,但是內(nèi)容卻改了

(9) Valid characters are alphanumeric haracters with dash and underscore only

150d84e4-9891-11ee-be60-92fbcf53809c.png

原因:在LVDS添加Block時(shí)不能添加bus,所以在Input Pin/Bus Name中命名上不能像總線一樣添加[*]

(10)interface Designer打不開(kāi)定位思路。

152cd510-9891-11ee-be60-92fbcf53809c.png

原因:查一下下面幾點(diǎn):

1. 系統(tǒng)環(huán)境路徑設(shè)置

1547c654-9891-11ee-be60-92fbcf53809c.png

2. python是否在firewall 允許的程序列表里

155e4cc6-9891-11ee-be60-92fbcf53809c.png

3. microsoft visual c++2015有安裝嗎?

這個(gè)有一個(gè)安裝包,在打不開(kāi)的時(shí)候可以安裝

4. java 8有安裝嗎?

(11)燒寫(xiě)文件無(wú)法生成 Using source file "D:/customer_Prj/googol/phy_jtag_bridge/work_pnr/spi_flash_loader.lbf" Missing Interface Designer LPF constraint file, no programming file will be generated. Open Interface Designer to createa project. 原因:如果在interface Desinger中沒(méi)有添加接口是不會(huì)生成bit文件的。

審核編輯 黃宇

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