IEEE 1800-2023 SystemVerilog新版本正式發(fā)布了！

2024年3月初，在美國(guó)硅谷舉辦的DVCon2024上，IEEE-SA和Accellera聯(lián)合宣布通過(guò)IEEE Get Program可以免費(fèi)獲取IEEE 1800-2023 SystemVerilog語(yǔ)言參考手冊(cè)。

官方說(shuō)，這個(gè)版本主要是為了滿足硬件設(shè)計(jì)和驗(yàn)證語(yǔ)言日益增長(zhǎng)的需求。相比IEEE Std 1800-2017，不僅修正了錯(cuò)誤，還加強(qiáng)了易于設(shè)計(jì)的Feature，提升了驗(yàn)證，也增強(qiáng)了跨語(yǔ)言的交互。

在2023年的DVCon上，來(lái)自西門(mén)子 EDA的Dave Rich分享了一篇文章《What’s Next for SystemVerilog in the Upcoming IEEE 1800 standard》，講述了下一個(gè)版本的變化。

時(shí)隔一年之后，正式發(fā)布的IEEE 1800-2023是否還有新的變化或者驚喜嗎？感興趣的讀者可以自己下載后對(duì)比一下。

需要提一下的是，這次新版本的發(fā)布主要由以下公司參與制定：Cadence、Infineon、Intel、Marvell、NVIDIA、Qualcomm、Siemens、Synopsys、TI等。另有Acellera、Institute of Biomedical Engineering、Microsoft、Samsung、上海交大、ST、Verific等公司參與了投票和表決。幾乎清一色的美國(guó)公司。

我們知道從標(biāo)準(zhǔn)的發(fā)布到真正應(yīng)用到項(xiàng)目，還有一段路要走，主要取決于EDA公司什么時(shí)候適配到開(kāi)發(fā)和仿真軟件里。在這里也期待國(guó)產(chǎn)EDA們能夠早日追趕上來(lái)。

審核編輯：劉清

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原文標(biāo)題：IEEE 1800-2023 SystemVerilog新版本正式發(fā)布了，快來(lái)看看都有什么更新

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