精品国产人成在线_亚洲高清无码在线观看_国产在线视频国产永久2021_国产AV综合第一页一个的一区免费影院黑人_最近中文字幕MV高清在线视频

0
  • 聊天消息
  • 系統(tǒng)消息
  • 評論與回復
登錄后你可以
  • 下載海量資料
  • 學習在線課程
  • 觀看技術(shù)視頻
  • 寫文章/發(fā)帖/加入社區(qū)
會員中心
創(chuàng)作中心

完善資料讓更多小伙伴認識你,還能領(lǐng)取20積分哦,立即完善>

3天內(nèi)不再提示

音樂邏輯測試筆,Logic test circuits

454398 ? 2018-09-20 19:17 ? 次閱讀

音樂邏輯測試筆,Logic test circuits

關(guān)鍵字:邏輯測試電路圖,HY88

電路如圖所示。由一對互補型信號檢測控制管VT1、VT2及一片8聲效音樂集成電路HY-88等組成,采用微型揚聲器發(fā)聲,根據(jù)不同音樂來判斷被測邏輯狀態(tài)。
電路原理:電路中.HY-88是一片采用PCB(印刷線路板式軟封裝)封裝的8聲效音樂集成電路,它有s1~s8共8個觸發(fā)控制端,低電平觸發(fā)有效,對應著內(nèi)部ROM(只讀存儲器)預先存儲的8種動物叫聲,分別是蟲叫、蟋蟀、青蛙、布谷鳥、貓、狗、牛及馬蹄聲。調(diào)整振蕩電阻R4可改變叫聲音調(diào),音頻信號經(jīng)VT3放大后驅(qū)動揚聲器BL發(fā)聲。VD1、VD2是降壓二極,以使其Vdd,Vss間的工作電壓符合2.5V~4.5V范圍要求。該邏輯筆的檢測狀態(tài)為:(1)當探針T未接觸電路或檢測到“懸空”時,VT1和VT2均截止,Ic的觸發(fā)端s1、s2分別被R3、R2上拉為“1”,IC不工作,BL無聲;(2)當探針T檢測到“O”時,VT1截止,VT2導通,s2為“1”,s1被“0”觸發(fā),BL發(fā)出蟲鳴聲;(3)當探針T檢測到“1”時,VT1導通,VT2截止,S1為“1”,S2被“0”觸發(fā),BL發(fā)出蟋蟀叫聲;(4)當探針T檢測到“CP”脈沖時,、VT1、VT2輪流導通,s1、S2被交替觸發(fā),BL產(chǎn)生蟋蟀和蟲兩種嗚叫聲。
作者:沈左
聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
收藏 人收藏

    評論

    相關(guān)推薦

    CP測試和WAT測試有什么區(qū)別

    本文詳細介紹了在集成電路的制造和測試過程中CP測試(Chip Probing)和WAT測試(Wafer Acceptance Test)的目的、測試
    的頭像 發(fā)表于 11-22 10:52 ?151次閱讀
    CP<b class='flag-5'>測試</b>和WAT<b class='flag-5'>測試</b>有什么區(qū)別

    西門子推出Tessent In-System Test軟件

    西門子數(shù)字化工業(yè)軟件日前推出 Tessent In-System Test 軟件,作為一款突破性的可測試性設(shè)計(DFT)解決方案,旨在增強下一代集成電路(IC)的系統(tǒng)內(nèi)測試能力。
    的頭像 發(fā)表于 11-12 11:10 ?297次閱讀

    時序邏輯電路的基本概念、組成、分類及設(shè)計方法

    Logic Circuit)是一種在數(shù)字電路中,其輸出不僅取決于當前輸入,還取決于過去輸入歷史的電路。與組合邏輯電路(Combinational Logic Circuit)不同,組合邏輯
    的頭像 發(fā)表于 08-28 11:45 ?834次閱讀

    時序邏輯會產(chǎn)生鎖存器嗎

    時序邏輯電路本身并不直接“產(chǎn)生”鎖存器,但鎖存器是時序邏輯電路中的重要組成部分。時序邏輯電路(Sequential Logic Circuits
    的頭像 發(fā)表于 08-28 11:03 ?355次閱讀

    opa857在test mode下,out端輸出電壓不隨TEST_IN的電壓變化怎么解決?

    原理圖: CTRL(增益控制引腳): logic 0–5kΩ logic 1–20kΩ OPA857有兩種模式:normal mode 和 test mode ,由TEST_
    發(fā)表于 08-02 07:15

    組合邏輯電路邏輯功能的測試方法

    ,對組合邏輯電路邏輯功能的測試是確保數(shù)字系統(tǒng)正確性的關(guān)鍵步驟。 二、測試目的 組合邏輯電路邏輯
    的頭像 發(fā)表于 07-30 14:38 ?931次閱讀

    觸發(fā)器和時序邏輯電路詳解

    電路(Sequential Logic Circuits)則是由觸發(fā)器、邏輯門以及可能的時鐘信號源組成的電路,它們能夠處理隨時間變化的輸入信號,并產(chǎn)生隨時間變化的輸出信號。下面將詳細探討觸發(fā)器和時序
    的頭像 發(fā)表于 07-18 17:43 ?1204次閱讀

    模擬示波器能測試邏輯信號嗎

    模擬示波器是一種用于測量和顯示電壓波形的電子測試儀器,它能夠測量電壓、頻率、周期、相位等參數(shù)。雖然模擬示波器主要用于測量模擬信號,但在某些情況下,它也可以用于測試邏輯信號。 模擬示波器測試
    的頭像 發(fā)表于 07-17 16:56 ?358次閱讀

    組合邏輯控制器的設(shè)計步驟是什么

    組合邏輯控制器(Combinatorial Logic Controller)是一種數(shù)字電路,用于根據(jù)輸入信號生成輸出信號。它不包含存儲元件,因此輸出僅取決于當前的輸入信號。組合邏輯控制器廣泛應用
    的頭像 發(fā)表于 06-30 10:30 ?659次閱讀

    組合邏輯控制器的基本概念、實現(xiàn)原理及設(shè)計方法

    組合邏輯控制器(Combinatorial Logic Controller)是一種在數(shù)字電路中實現(xiàn)邏輯功能的設(shè)備,它根據(jù)輸入信號的當前狀態(tài)來產(chǎn)生輸出信號,而不考慮輸入信號的歷史狀態(tài)。組合邏輯
    的頭像 發(fā)表于 06-30 10:26 ?1567次閱讀

    車載T-Box邏輯功能測試方案

    北匯信息基于對客戶需求規(guī)范、行業(yè)法規(guī)及自身測試經(jīng)驗Know-How,為客戶提供完整和專業(yè)的T-Box邏輯功能測試解決方案。支持在實驗室環(huán)境及實車環(huán)境下完成T-Box上層邏輯功能
    的頭像 發(fā)表于 04-26 11:19 ?1031次閱讀
    車載T-Box<b class='flag-5'>邏輯</b>功能<b class='flag-5'>測試</b>方案

    CPLD組成和邏輯塊作用介紹

    在CPLD(Complex Programmable Logic Device,復雜可編程邏輯器件)中,邏輯塊是實現(xiàn)邏輯功能的核心模塊。它主要由可編程乘積項陣列(即與陣列)、乘積項分配
    的頭像 發(fā)表于 04-07 17:37 ?2126次閱讀
    CPLD組成和<b class='flag-5'>邏輯</b>塊作用介紹

    邏輯測試儀電路圖分享

    邏輯測試儀是一種用于電子與通信技術(shù)領(lǐng)域的電子測量儀器,主要用于測試數(shù)字系統(tǒng)的邏輯關(guān)系。
    的頭像 發(fā)表于 02-12 15:49 ?1307次閱讀
    <b class='flag-5'>邏輯</b><b class='flag-5'>測試</b>儀電路圖分享

    通用陣列邏輯(GAL)電路結(jié)構(gòu)設(shè)計分析

    通用陣列邏輯(GAL)是一種可編程邏輯器件,由Lattice公司在PAL(可編程陣列邏輯)的基礎(chǔ)上設(shè)計出來。GAL采用可編程的輸出邏輯宏單元OLMC(Output
    發(fā)表于 02-02 12:21 ?1834次閱讀
    通用陣列<b class='flag-5'>邏輯</b>(GAL)電路結(jié)構(gòu)設(shè)計分析

    可編程邏輯陣列PLA內(nèi)部邏輯結(jié)構(gòu)示意

    可編程邏輯陣列(Programmable Logic Array,PLA)和可編程陣列邏輯(Programmable Array Logic,PAL)都是數(shù)字
    發(fā)表于 02-02 11:41 ?2494次閱讀
    可編程<b class='flag-5'>邏輯</b>陣列PLA內(nèi)部<b class='flag-5'>邏輯</b>結(jié)構(gòu)示意