--- 產(chǎn)品參數(shù) ---
- 信噪比(SNR) 65 dBFS
- SFDR -78 dBc
- 差分非線性(DNL) ±0.5 LSB
--- 產(chǎn)品詳情 ---
AD9434是一款12位單芯片采樣模數(shù)轉(zhuǎn)換器(ADC),專門針對高性能、低功耗和易用性進行了優(yōu)化。該器件的轉(zhuǎn)換速率最高可達500 MSPS,具有出色的動態(tài)性能,適合寬帶載波和寬帶系統(tǒng)使用。芯片上集成了全部必需功能,包括采樣保持器與基準電壓源,可提供完整的信號轉(zhuǎn)換解決方案。VREF引腳可用來監(jiān)控內(nèi)部基準電壓或提供外部基準電壓(必須通過SPI端口使能外部基準電壓模式)。
該ADC要求采用1.8 V模擬電源供電及差分時鐘信號,以便充分發(fā)揮其工作性能。數(shù)字輸出為LVDS (ANSI-644) 兼容,支持二進制補碼、偏移二進制或格雷碼格式。該ADC還提供數(shù)據(jù)時鐘輸出,用于正確進行輸出數(shù)據(jù)定時。
AD9434采用先進的BiCMOS工藝制造,提供56引腳LFCSP封裝,額定溫度范圍為-40°C至+85°C工業(yè)溫度范圍。該器件受美國及國際專利保護。
應用
- 無線和有線寬帶通信
- 電纜反轉(zhuǎn)通路
- 通信測試設備
- 雷達和衛(wèi)星子系統(tǒng)
- 功率放大器線性化
產(chǎn)品聚焦
- 高性能。
500 MSPS、250 MHz輸入時信噪比維持在65 dBFS。 - 低功耗。
500 MSPS時功耗僅660 mW。 - 易于使用。
LVDS輸出數(shù)據(jù)和輸出時鐘信號允許與現(xiàn)行FPGA接口。片內(nèi)基準電壓源和采樣保持功能使系統(tǒng)設計更靈活,采用1.8 V單電源則簡化了系統(tǒng)電源設計。 - 串行端口控制
標準串行端口接口支持各種產(chǎn)品功能,例如:數(shù)據(jù)格式化、省電模式、增益調(diào)整及生成輸出測試碼等。
- 信噪比(SNR):65 dBFS(fIN最高為250MHz,500 MSPS)
- 有效位數(shù)(ENOB):10.5位(fIN最高為250 MHz,500 MSPS,?1.0 dBFS)
- 無雜散動態(tài)范圍(SFDR):-78 dBc(fIN最高為250 MHz,500 MSPS,?1.0 dBFS)
- 集成輸入緩沖器
- 出色的線性度
- 差分非線性(DNL):±0.5 LSB(典型值)
- 積分非線性(INL):±0.6 LSB(典型值)
- 500 MSPS時提供LVDS輸出(ANSI -644電平)
- 1 GHz全功率模擬帶寬
- 片內(nèi)基準電壓源,無需外部解耦
- 低功耗
- 690 mW (500 MSPS)—LVDS SDR模式
- 660 mW (500 MSPS)—LVDS DDR模式
- 可編程(標稱)輸入電壓范圍
- 1.18 V p-p至1.6 V p-p、1.5 V p-p(標稱值)
- 1.18 V p-p至1.6 V p-p、1.5 V p-p(標稱值)
- 可選擇輸出數(shù)據(jù)格式(偏移二進制、二進制補碼、格雷碼)
- 時鐘占空比穩(wěn)定器
- 帶可編程時鐘和數(shù)據(jù)對準功能的集成數(shù)據(jù)時鐘輸出
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