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      電子發燒友網>電子資料下載>通信網絡>一種基于插值算法符號同步的硬件設計

      一種基于插值算法符號同步的硬件設計

      2010-07-05 | rar | 246 | 次下載 | 3積分

      資料介紹

      提出了一種數字接收機中符號同步的硬件設計方案。該方案屬于異步采樣恢復法，其插值濾波器的設計采用了理想插值算法加窗處理，較傳統的拉格朗日插值有更好的頻域特性。該設計方案已用VerilogHDL實現，并通過了綜合及時序驗證。
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