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設計了一種基于DSP+CPLD構(gòu)架的電能質(zhì)量監(jiān)測裝置，該裝置利用CPLD產(chǎn)生DSP外圍器件的控制時序，丈中詳細介紹了CPLD對DSP外圍器件的邏輯接口設計，通過MAX+PLUSII對CPLD的控制時序進行仿真，仿真結(jié)果驗證了本設計的可行性，試驗測試結(jié)果表明該裝置實現(xiàn)了多項電能質(zhì)量指標的實時在線監(jiān)測。
系統(tǒng)硬件結(jié)構(gòu)設計
系統(tǒng)的硬件結(jié)構(gòu)如圖1所示。本裝置的任務是完成對被監(jiān)測信號的模數(shù)轉(zhuǎn)換和各相電能質(zhì)量指標的分析計算、存儲和上傳。硬件系統(tǒng)包括A／D轉(zhuǎn)換單元、數(shù)字處理單元（DSP）、外擴程序空間（SRAM）、外擴數(shù)據(jù)儲存單元（FLASH）、邏輯控制單元（CPLD）、異步通信接口單元（TLl6C550）、人機接口（按鍵、液晶顯示）。
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