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      電子發燒友網>電子資料下載>可編程邏輯>EDA-教程>PCB設計規則>PCB終端匹配電阻設計

      PCB終端匹配電阻設計

      2017-04-27 | pdf | 292KB | 次下載 | 1積分

      資料介紹

      　　匹配電阻位置的變化對信號波形的影響

      　　3.1 并聯終端匹配情況－匹配電阻位于接收端之前如圖 1a 所示。

      　　我們構建了三組終端匹配的結構。第一組結構中終端匹配電阻直接與接收器相連（理想狀態，圖 1a 上）；第二組結構中終端匹配電阻位于距離終端 0.5in.處（圖 1a 中），即有 0.5in.的傳輸線沒有被匹配；第三組結構中終端匹配電阻位于終端 1in.處（圖 1a 下）。驅動器和接收器模型選用 Hyperlynx7.0 自帶的簡易 IBIS 模型：CMOS，3.3V，FAST （該模型驅動波形的上升時間約為 1.5ns）。傳輸線特征阻抗為 92.9 歐姆，傳輸線總長為 20in. （約為 0.5m 左右），總的延遲時間為 2.975ns，線寬為 6mil。驅動信號的頻率為 100MHZ，

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