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      電子發燒友網>電子資料下載>DSP>基于SRAM編程技術的PLD核心可重構電路結構設計

      基于SRAM編程技術的PLD核心可重構電路結構設計

      2009-11-30 | rar | 225 | 次下載 | 2積分

      資料介紹

      CPLD 相對于FPGA 更適合實現時序邏輯較少而組合邏輯相對復雜的功能，比如復雜的狀態機和譯碼電路等。CPLD 的EEPROM 編程技術不適合動態可重構的應用。本文針對 CPLD 的核心可編程結構：P-Term 和可編程互連線，采用2.5V、0.25μmCMOS 工藝設計了功能相近的基于SRAM 編程技術的可重構電路結構。新的電路結構可以通過可編程方式有效控制功耗和速度的折衷，并且相對于傳統的CPLD 互聯結構減少了50%的編程數據。在動態可重構系統中，采用上述新結構的PLD 相對于FPGA 可以更有效地實現可重構的復雜狀態機和譯碼電路等應用。
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