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      電子發燒友網>電子資料下載>電子教材>集成電路中的時延可測性設計

      集成電路中的時延可測性設計

      2011-05-28 | pdf | 496 KB | 次下載 | 免費

      資料介紹

      ?

      隨著集成電路制造工藝的特征尺寸不斷減小，高性能集成電路產品的定時約束變得越來越嚴格。各種制造缺陷如阻性開路、阻性短路、通孔中形成空洞以及柵氧化層失效等現象的影響在當前先進的集成電路制造工藝下也變得越來越顯著。為了確保芯片的出廠質量，通常需要對其進行有效的時延測試。對集成電路進行時延可測性設計不僅可以非常有效地檢測芯片中的時延缺陷，而且可以為芯片在量產前進行有效的調試。在本文當中，我們首先介紹了集成電路中的時延缺陷對芯片性能和可靠性的影響，然后分別介紹了一些采用時延可測性設計技術來提高芯片時延測試故障覆蓋率、精簡時延測試向量集規模、檢測芯片中小時延缺陷以及對芯片的時延故障進行在線檢測的方法。
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