資料介紹
本文介紹了一種通過單邊帶來估計時鐘源的相位噪聲的通用公式。載波比(SSCR),振蕩周期的周期抖動。該鏈接允許無縫聚合。
外部時鐘源相位噪聲,通常以dBC/Hz給出,與片上時鐘同步電路的相位穩定圖相比,通常以PS RMS為準。這允許依次評估它們對采樣電路的總孔徑抖動的影響,從而最終能夠確定如系統中所示的類似于數字轉換器的系統的SNR。
時域和頻域數字的關系的有效性首先在雙極和CMOS集成VCO的相位譜上進行了測試;此后,基于PLL的頻率合成器的最流行情況已經被采用時間toApple來處理。轉換技術,或專用的相位噪聲測試設備。
通過使用這里提出的公式并在250FS中嚴格量化的優化ARTEPOLL抖動的狀態所啟用的最佳性能,在德克薩斯儀器ADS5420上展示,用于3G無線基礎設施BTS應用的高速14B 6MSPS ADC。
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