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      電子發燒友網>電子資料下載>單片機>如何通過3個方面來提高ADC優化時鐘信號的轉換速率概述

      如何通過3個方面來提高ADC優化時鐘信號的轉換速率概述

      2018-05-24 | rar | 1.44 MB | 次下載 | 免費

      資料介紹

      　　新的高速ADC配備了一個大的模擬輸入帶寬（約三至六倍的最大采樣頻率），因此它們可以用于欠采樣應用。ADC設計的最新進展顯著地擴展了可用的輸入范圍，使得系統設計者可以消除至少一個中頻級，這降低了成本和功耗。在欠采樣接收機的設計中，必須特別注意采樣時鐘，因為在較高的輸入頻率下，時鐘的抖動成為限制信噪比（SNR）的主導因素。

      　　這三部分文章系列的第1部分著重于如何準確地估計時鐘源的抖動，并將其與ADC的孔徑抖動相結合。在第2部分中，該組合抖動將用于計算ADC的SNR，然后將其與實際測量進行比較。第3部分將展示如何通過改善ADC的孔徑抖動來進一步提高ADC的SNR，重點是優化時鐘信號的轉換速率。

      如何通過3個方面來提高ADC的優化時鐘信號的轉換速率概述

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