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ADS61823是一個12位A/D轉(zhuǎn)換器（ADC），其最大采樣頻率為80 MSPS。它在緊湊的32-QFN封裝中結(jié)合了高性能和低功耗。模擬輸入使用緩沖器來隔離內(nèi)部采樣和從外部驅(qū)動電路保持的開關(guān)瞬變。緩沖輸入具有非常低的輸入電容（＜2PF）和寬的帶寬。這比在沒有輸入緩沖器的ADC時容易在高輸入頻率下驅(qū)動它們。
ADS61823具有用于在較低的滿量程模擬輸入范圍內(nèi)改善SFDR性能的粗和細(xì)增益選項。
數(shù)字?jǐn)?shù)據(jù)輸出是并行CMOS或DDR LVDS（雙數(shù)據(jù)速率）。有幾個特點，以簡化數(shù)據(jù)捕獲控制輸出時鐘位置和輸出緩沖驅(qū)動強(qiáng)度，加上LVDS電流和內(nèi)部終止可編程性。
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