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      如何使用FPGA實(shí)現(xiàn)神經(jīng)網(wǎng)絡(luò)實(shí)現(xiàn)混沌吸引子公鑰加密算法

      2021-03-26 | rar | 0.43 MB | 次下載 | 免費(fèi)

      資料介紹

      　　利用具有顧序和并行執(zhí)行的特點(diǎn)的VHDL語(yǔ)言，設(shè)計(jì)并實(shí)現(xiàn)了基于神經(jīng)網(wǎng)絡(luò)混沌吸引子的公鑰加密算法。在編解碼器設(shè)計(jì)中采用專用的控制模塊來(lái)控制加密和解密操作；同時(shí)，在RAM模塊中自主設(shè)計(jì)了具有并行讀寫功能的子模塊，以進(jìn)一步提高算法的數(shù)據(jù)加密速度；整個(gè)系統(tǒng)在DE2實(shí)驗(yàn)平臺(tái)中經(jīng)過反復(fù)實(shí)驗(yàn)測(cè)試和試運(yùn)行，結(jié)果表明該算法是可以硬件實(shí)現(xiàn)的，并且具有較高的數(shù)據(jù)加密速度．時(shí)鐘頻率可達(dá)50 MHz以上．



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