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      電子發燒友網>電子資料下載>IC datasheet pdf>DS90CR485,pdf datasheet (133MH

      DS90CR485,pdf datasheet (133MH

      2009-10-14 | rar | 556 | 次下載 | 3積分

      資料介紹

      The DS90CR485 serializes the 24 LVCMOS/LVTTL double
      edge inputs (48 bits data latched in per clock cycle) onto 8
      Low Voltage Differential Signaling (LVDS) streams. A phaselocked
      transmit clock is also in parallel with the data streams
      over a 9th LVDS link. The reduction of the wide TTL bus to a
      few LVDS lines reduces cable and connector size and cost.
      The double edge input strobes data on both the rising and
      falling edges of the clock. This minimizes the pin count
      required and simplifies PCB routing between the host chip
      and the serializer.
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