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      電子發燒友網>電子資料下載>IC datasheet pdf>SN54LV125A, SN74LV125A,PDF9QUA

      SN54LV125A, SN74LV125A,PDF9QUA

      2010-07-19 | rar | 780 | 次下載 | 3積分

      資料介紹

      The ’LV125A quadruple bus buffer gates are designed for 2-V to 5.5-V VCC operation.

      These devices feature independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE)\ input is high.

      To ensure the high-impedance state during power up or power down, OE\ should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.

      These devices are fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs, preventing damaging current backflow through the devices when they are powered down.

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