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      電子發燒友網>電子資料下載>IC datasheet pdf>SN74LV125AT,pdf(QUADRUPLE BUS

      SN74LV125AT,pdf(QUADRUPLE BUS

      2010-07-19 | rar | 610 | 次下載 | 2積分

      資料介紹

      The SN74LV125AT is a quadruple bus buffer gate. This device features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE) input is high.

      To ensure the high-impedance state during power up or power down, OE should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.

      This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.

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