資料介紹
These devices consist of bus-transceiver circuits with 3-state or open-collector outputs, D-type flip-flops, and control circuitry arranged for multiplexed transmission of data directly from the data bus or from the internal storage registers. Data on the A or B bus is clocked into the registers on the low-to-high transition of the appropriate clock (CLKAB or CLKBA) input. Figure 1 illustrates the four fundamental bus-management functions that can be performed with the octal bus transceivers and registers.
Output-enable () and direction-control (DIR) inputs control the transceiver functions. In the transceiver mode, data present at the high-impedance port may be stored in either or both registers.
- SN74LVCZ245A,pdf(OCTAL BUS TRA
- SN74LVCR2245A,pdf(OCTAL BUS TR
- SN74LVC245A,pdf(Octal Bus Tran
- SN74ALVCH245,pdf(OCTAL BUS TRA
- SN74ALVC245,pdf(OCTAL BUS TRAN
- SN74ALS645A-1,pdf(Octal Bus Tr
- SN74ALS642A-1,pdf(Octal Bus Tr
- SN74ALS641A-1,pdf(Octal Bus Tr
- SN74ALS640B-1,pdf(Octal Bus Tr
- SN74ALS638A-1,pdf(Octal Bus Tr
- SN74ALS621A-1,pdf(Octal Bus Tr
- SN54LVC646A, SN74LVC646A,pdf(O
- SN74LVC2952A,pdf(Octal Bus Tra
- SN74ALS2541,pdf(Octal Line Dri
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