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      電子發燒友網>電子資料下載>IC datasheet pdf>SN54HC112, SN74HC112,pdf(DUAL

      SN54HC112, SN74HC112,pdf(DUAL

      2010-08-02 | rar | 730 | 次下載 | 3積分

      資料介紹

      The ’HC112 devices contain two independent J-K negative-edge-triggered flip-flops. A low level at the preset (PRE)\ or clear (CLR)\ inputs sets or resets the outputs, regardless of the levels of the other inputs. When (PRE)\ and (CLR)\ are inactive (high), data at the J and K inputs meeting the setup time requirements are transferred to the outputs on the negative-going edge of the clock (CLK) pulse. Clock triggering occurs at a voltage level and is not directly related to the fall time of the CLK pulse. Following the hold-time interval, data at the J and K inputs may be changed without affecting the levels at the outputs. These versatile flip-flops perform as toggle flip-flops by tying J and K high.

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