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現場可編程門陣列（FPGA）器件以其靈活的可配置特性，可以很好地解決并行性和速度問題在數字信號領域得到廣泛地應用,但要求使用VHDL 或VerilogHDL 語言進行設計的難度較大。本文提出了一種采用FPGA 實現無限沖激響應濾波器的設計方案。并以一個四階低通IIR 數字濾波器的實現為例,設計并完成軟硬件仿真與驗證。結果表明,方法簡單易行,能滿足設計要求。
在信息信號處理過程中，如對信號的過濾、檢測、預測等，都要使用到濾波器，數
字濾波器是數字信號處理中使用最廣泛的一種方法。常用的數字濾波器有無限長單位脈沖響應（IIR）濾波器和有限長單位脈沖響應（FIR）濾波器兩種[1], 其中IIR 濾波器輸出不僅與即時的輸入以及過去的輸入有關,而且還與過去的輸出有關，反饋環路極易造成系統的不穩定。在采用FPGA 器件實現數字濾波器時，與FIR 濾波器相比，設計和實現IIR 濾波器的算法更為復雜。但IIR 濾波器也具有多種優越性，如IIR 濾波器可以利用模擬濾波器的設計成果，工作量相對較小；對于相同的設計指標，它可以用較低的階數獲得高選擇性，所用存儲單元少，經濟而效率高，在相同門級規模和相同時鐘速度下可以提供更好的帶外衰減特性。
本文采取了一種基于FPGA 的濾波器設計方法，可以使設計IIR 濾波器較為簡單易行。
在信息信號處理過程中，如對信號的過濾、檢測、預測等，都要使用到濾波器，數
字濾波器是數字信號處理中使用最廣泛的一種方法。常用的數字濾波器有無限長單位脈沖響應（IIR）濾波器和有限長單位脈沖響應（FIR）濾波器兩種[1], 其中IIR 濾波器輸出不僅與即時的輸入以及過去的輸入有關,而且還與過去的輸出有關，反饋環路極易造成系統的不穩定。在采用FPGA 器件實現數字濾波器時，與FIR 濾波器相比，設計和實現IIR 濾波器的算法更為復雜。但IIR 濾波器也具有多種優越性，如IIR 濾波器可以利用模擬濾波器的設計成果，工作量相對較小；對于相同的設計指標，它可以用較低的階數獲得高選擇性，所用存儲單元少，經濟而效率高，在相同門級規模和相同時鐘速度下可以提供更好的帶外衰減特性。
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