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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>Nios SoC系統中的BCH編解碼IP核的設計

      Nios SoC系統中的BCH編解碼IP核的設計

      2009-11-30 | rar | 225 | 次下載 | 3積分

      資料介紹

      循環碼是最重要的一類線性分組糾錯碼， 而BCH 碼又是目前發現的性能很好且應用
      廣泛的循環碼， 它具有嚴格的代數理論， 對它的理論研究也非常透徹。BCH 碼的實現途徑有軟件和硬件兩種。軟件實現方法靈活性強且較易實現， 但硬件實現方法的工作速度快， 在高數據速率和長幀應用場合時具有優勢。FPGA(現場可編程門陣列)為DSP 法的硬件實現提供了很好的平臺，但如果單獨使用一片FPGA 實現BCH 編解碼，對成本、功耗和交互速度都不利。最新的SoC(片上系統)設計方法可以很好地解決這個問題。
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