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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>一種GPS信號干擾源的設計與實現

      一種GPS信號干擾源的設計與實現

      2009-12-19 | rar | 221 | 次下載 | 5積分

      資料介紹

      GPS 的干擾與抗干擾問題具有十分重要的研究意義。本文提出了一種GPS 干擾源的
      設計方案，并重點分析了干擾源中頻信號的產生方法。中頻信號的產生基于FPGA 硬件平臺，頂層設計以直接數字頻率合成器(DDS)為核心模塊，可以產生單頻、掃頻、寬/窄帶等三種模式的低中頻干擾信號。利用AD9777 芯片同時完成對低中頻信號的數字上變頻和數模轉換，在將數字波形轉換為模擬信號的同時得到了較高中頻的干擾信號輸出。DDS 產生低中頻信號保證了信號失真小，AD9777 的使用節省了硬件資源。文中給出了FPGA 設計的仿真波形和最后的實測結果，結果表明該設計方案正確、可行。
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