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FPGA 原型設(shè)計(jì)人員艱苦努力所得的明顯回報(bào)就是 ASIC* 設(shè)計(jì)可以及時(shí)而毫無問題地完成產(chǎn)品定案(tape-out)。不過，原型設(shè)計(jì)還有一點(diǎn)日益重要的優(yōu)勢，即 ASIC 或 SoC 中嵌入的軟件在項(xiàng)目開發(fā)的早期階段便可與實(shí)際速度硬件進(jìn)行完美集成。
為什么軟件團(tuán)隊(duì)要關(guān)注 FPGA 原型設(shè)計(jì)問題
獨(dú)立的 EDA 分析師 Gary Smith 指出（見圖 1），SoC 采用的CMOS工藝節(jié)點(diǎn)日益小型化，而且技術(shù)越來越復(fù)雜，因此軟件組成部分已成為產(chǎn)品特色和開發(fā)焦點(diǎn)所在。進(jìn)入市場的最新消費(fèi)類器件多采用復(fù)雜的 SoC，其中包括眾多嵌入式處理器和幾十萬甚至數(shù)百萬行代碼。Apple iPhone 就是一個(gè)很好的例子，它至少包含 3 個(gè) ARM 處理器。加速產(chǎn)品上市進(jìn)程對產(chǎn)品推出至關(guān)重要，在此情況下，怎么才能在 SoC 環(huán)境中進(jìn)行軟件驗(yàn)證呢？
SoC 開發(fā)團(tuán)隊(duì)越來越多地開始采用 FPGA 原型設(shè)計(jì)作為解決方案來進(jìn)行驗(yàn)證并及時(shí)推出各種類型的產(chǎn)品。
為什么軟件團(tuán)隊(duì)要關(guān)注 FPGA 原型設(shè)計(jì)問題
獨(dú)立的 EDA 分析師 Gary Smith 指出（見圖 1），SoC 采用的CMOS工藝節(jié)點(diǎn)日益小型化，而且技術(shù)越來越復(fù)雜，因此軟件組成部分已成為產(chǎn)品特色和開發(fā)焦點(diǎn)所在。進(jìn)入市場的最新消費(fèi)類器件多采用復(fù)雜的 SoC，其中包括眾多嵌入式處理器和幾十萬甚至數(shù)百萬行代碼。Apple iPhone 就是一個(gè)很好的例子，它至少包含 3 個(gè) ARM 處理器。加速產(chǎn)品上市進(jìn)程對產(chǎn)品推出至關(guān)重要，在此情況下，怎么才能在 SoC 環(huán)境中進(jìn)行軟件驗(yàn)證呢？
SoC 開發(fā)團(tuán)隊(duì)越來越多地開始采用 FPGA 原型設(shè)計(jì)作為解決方案來進(jìn)行驗(yàn)證并及時(shí)推出各種類型的產(chǎn)品。
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