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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于CPLD的電器定時(shí)開(kāi)關(guān)控制系統(tǒng)設(shè)計(jì)

      基于CPLD的電器定時(shí)開(kāi)關(guān)控制系統(tǒng)設(shè)計(jì)

      2010-12-17 | rar | 641 | 次下載 | 5積分

      資料介紹

      以CPLD器件EPM7128SLC84-6為核心的電器定時(shí)開(kāi)關(guān)控制系統(tǒng)設(shè)計(jì)實(shí)現(xiàn)24小時(shí)制時(shí)鐘功能，可同時(shí)設(shè)置多個(gè)電器的定時(shí)自動(dòng)開(kāi)啟和關(guān)閉，開(kāi)關(guān)時(shí)間從0時(shí)0分到23時(shí)59分之間任意可調(diào)。CPLD部分使用Verilog HDL在QuartusⅡ5.0環(huán)境中編寫，并給出了主要設(shè)計(jì)程序。
      Abstract:
      ?In this paper,the electrical apparatus timing on-off control system which the CPLD EPM7128SLC84-6 is the core, can realize a 24-hour clock function. It can set the time to turn on or turn off automatically for many electrical apparatuses, the turn-on or turn-off time of which is adjustable from 0:00 to 23:59.The programme of CPLD is programed in Verilog HDL in Quartus Ⅱ 5.0. Most of the design programme is shown in the paper.
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