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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的窄帶干擾抑制算法在GPS中的應用

      基于FPGA的窄帶干擾抑制算法在GPS中的應用

      2013-09-23 | pdf | 1.4 MB | 次下載 | 免費

      資料介紹

      針對GPS接收機有效信號弱，易受窄帶干擾影響的不足，提出了一種基于FPGA的窄帶干擾抑制算法的實現方案。該方案以Xilinx公司的Virtex5芯片為硬件平臺，采用重疊加窗頻域濾波算法和自適應多門限檢測技術實現窄帶干擾的實時檢測和抑制，最后采用重疊相加的方法進行數據輸出。測試結果表明，該設計能為GPS接收機提供至少60dB的抗窄帶干擾能力。與其他窄帶干擾抑制方法相比，收斂速度和信噪比損耗都得到了改善。

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