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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的GPS的時鐘同步設計論文

      基于FPGA的GPS的時鐘同步設計論文

      2014-06-05 | doc | 604KB | 次下載 | 3積分

      資料介紹

      本文在綜合分析基于GPS的標準定時系統應具備的主要功能和FPGA特點的基礎上，提出了一種基于GPS的標準定時系統設計方案，實現了高精度時間信號和時、分、秒同步脈沖的輸出，時間信息的顯示等功能。FPGA作為系統核心提高了數據的處理速度和同步精度。
      ??? 本設計采用FPGA作為GPS同步時鐘裝置的控制和數據處理核心，取代目前應用較多的以單片機為核心的控制和數據處理單元，在減小系統體積、降低開發和維護成本以及提高系統穩定性的同時，通過對設計的優化，加快了數據的處理速度，提高了同步精度，并實現了秒脈沖在GPS失步時的平滑切換，有著重要的應用價值。同時，基于FPGA的設計也使系統實現了小型化的目標，提高了系統穩定性，并使維護和升級更加方便。
      通過時序仿真和分析驗證，基于FPGA的設計方案完全能夠滿足GPS同步時鐘對于較高的同步精度的要求。FPGA芯片總的邏輯單元占用情況為系統升級預留了較多的資源。以此設計作為平臺，根據不同的應用要求，可以方便地擴展出不同的功能單元，比如網絡授時接口、IRIG-B編碼輸出等更多形式的輸出模塊。
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