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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>利用格雷碼指針實現在多時鐘域傳遞數據的FIFO設計

      利用格雷碼指針實現在多時鐘域傳遞數據的FIFO設計

      2014-07-09 | pdf | 171KB | 次下載 | 1積分

      資料介紹

      在大規模集成電路設計中，一個系統包含了很多不相關的時鐘信號，當其目標域時鐘與源域時鐘不同時，如何在這些不同域之間傳遞數據成為了一個重要問題。為了解決這個問題，我們可以用一種異步 FIFO（先進先出）存儲器來實現。本文介紹了一種利用格雷碼指針實現在多時鐘域傳遞數據的FIFO設計。 
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