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在高速有限沖擊響應( Finite Impulse Ｒesponse，FIＲ) 數字濾波器的設計中，隨著濾波器階數的增加，保持數據流速率和有效使用硬件資源成為設計的一個重點和難點。基于高速并行有限沖擊響應數字濾波器的基本原理，提出了一種將位平面法、正則有符號系數( Canonical-Signed Digit，CSD) 編碼算法和抽取算法應用于并行有限沖擊響應數字濾波器的改進方法。設計通過 Matlab 仿真，在 Quartus II 中編譯、仿真、綜合后下載到現場可編程門陣列( Field Programmable Gate Array，FPGA) 中進行測試，結果顯示，這種改進方法較好地解決了濾波器階數和數據流速率與硬件資源之間的關系。
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