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FPGA 動態局部可重構技術通常將系統劃分為固定模塊和可重構模塊，可重構模塊與其他模塊之間的通信都是通過使用特殊的總線宏實現的。總線宏的正確設計是實現FPGA 動態局部可重構技術的關鍵。在研究了FPGA 動態局部可重構技術中基于三態緩沖器（ Tri2state Buffer ，TBUF） 總線宏結構的基礎上，采用Xilinx ISE FPGA Editor 可視化的方法實現總線宏的設計，并借助可重構硬件平臺———XCV800 驗證板，通過設計動態可重構實驗，論證總線宏設計的正確性。
FPGA 動態局部可重構技術是指允許可重構的器件或系統的一部分進行重新配置，配置過程中其余部分的工作不受影響。動態局部可重構縮短了重構的時間，減少了系統重構的開銷，提高了系統的運行效率。局部動態可重構技術中通常將系統劃分為固定模塊和可重構模塊。可重構模塊與其他模塊之間的通信（包括可重構模塊和固定模塊之間、可重構模塊和可重構模塊之間） 都是由總線宏實現的。
動態可重構技術在FPGA 中的實現是Xilinx 公司首先提出的，并且提供了相應的開發工具和開發流程。他們從Virtex 系列器件開始支持動態可重構技術，同時他們提供了現成的總線宏文件給動態可重構系統開發者使用，但是它們提供的總線宏設計與軟件版本的兼容性很差。Xilinx 提供的總線宏可能因為軟件版本的問題會無法正常使用，所以用戶需要借助正在使用的版本軟件設計總線宏，以實現FPGA 動態局部可重構設計。
在研究總線宏的結構基礎上，采用FPGA Editor可視化的方法設計基于TBUF 的總線宏，并通過FP2GA 動態可重構實驗驗證了該方法的正確性。
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