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一、實驗目的
1.了解FPGA 開發環境及基本操作。
2. 熟悉基于FPGA 的數字設計方法和步驟。
3. 掌握電路的綜合和實現。
4. 掌握電路仿真與時序分析。
5. 熟悉3/8 線譯碼器工作原理
6. 設計5 人表決器。
二、實驗內容和基本原理
1、3/8 線譯碼器
（1） 以3/8 線譯碼器為例，以Basys 2開發板中的三個撥位開關， SW2，SW1，SW0 為三個輸入信號，可以代表8 種不同的狀態，該譯碼器對這8 種狀態譯碼，并把所譯碼的結果在八個發光二級管（ LD7~LD0 ）上顯示。
（2） 輸入與輸出之間邏輯關系
2、5 人表決器
（1） 以Basys 2開發板中的5 個撥位開關， SW4，SW3，SW2，SW1，SW0為7 個輸入信號，可以代表5 個表決的人，當5 個人中有3 個以上同意時，則表決通過，將表決的結果在LD0 上顯示出來。
（2） 當表決通過時，將通過票數在最右側在數碼管（SEG0）上顯示出來。
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