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電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>使用FPGA實現(xiàn)數(shù)字鐘設(shè)計的資料說明

使用FPGA實現(xiàn)數(shù)字鐘設(shè)計的資料說明

2021-01-19 | rar | 0.99 MB | 次下載 | 免費

資料介紹

  一、實驗?zāi)康模?/p>

  通過設(shè)計實例,深入理解自頂向下設(shè)計方法,系統(tǒng)設(shè)計規(guī)范、系統(tǒng)設(shè)計、模塊設(shè)計和系統(tǒng)仿真與實現(xiàn)各階段的設(shè)計內(nèi)容,初步掌握規(guī)范的數(shù)字系統(tǒng)設(shè)計方法并實踐。

  二、實驗要求:

  1、系統(tǒng)概述:設(shè)計一個用 LED 7段顯示器顯示的24小時制數(shù)字鐘。

  2、系統(tǒng)目標(biāo):

  (1)用8個LED 顯示時間,如9點25分10秒顯示為,09-25-10。

  (2)設(shè)置2個按鍵,按鍵SET用于工作模式選擇,按鍵UP用于設(shè)置數(shù)值。(可選)

  (3)按SET鍵循環(huán)設(shè)置工作模式為:正常顯示-》時設(shè)置-》分設(shè)置-》秒設(shè)

  置。在設(shè)置工作模式時,被設(shè)置相應(yīng)數(shù)字按1秒速率閃爍,其它數(shù)字不變。

  (4)在設(shè)置工作模式時,按UP鍵一次,被設(shè)置相應(yīng)數(shù)字增加1,加到最大值后再加返回0,如小時加到23后再加就返回0,分和秒加到59后再加返回0 。

  3、系統(tǒng)設(shè)計依據(jù):

  外部輸入時鐘為40MHZ,通過分頻產(chǎn)生秒脈沖信號,用模60計數(shù)器對其計數(shù)產(chǎn)生分脈沖信號,對分脈沖用模60計數(shù)器對其計數(shù)產(chǎn)生時脈沖信號,再用模24計數(shù)器對時脈沖計數(shù),即可實現(xiàn)一天24小時的時間信號,通過7段LED數(shù)碼管顯示出來則為基本數(shù)字鐘,校時電路通過兩個外部異步按鍵對“時”、“分”、“秒”顯示數(shù)字進(jìn)行校對調(diào)整。

  4、系統(tǒng)實現(xiàn)要求:

  要求用Mars-EP1C3-EDA實驗平臺。芯片與封裝選擇:本設(shè)計用EP1C3T FPGA實現(xiàn),144腳封裝,輸入輸出為LVTTL電平。

  5、系統(tǒng)驗證及測試要求:

  用Mars-EP1C3-EDA實驗平臺搭建模擬測試平臺測試,測試驗證數(shù)字鐘實現(xiàn)設(shè)計目標(biāo)。

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