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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用FPGA實現神經網絡硬件的設計方法

      如何使用FPGA實現神經網絡硬件的設計方法

      2021-02-02 | rar | 0.53 MB | 次下載 | 免費

      資料介紹

      　　提出了一種可以靈活適應不同的工程應用中神經網絡在規模、拓撲結構、傳遞函數和學習算法上的變化，并能及時根據市場需求快速建立原型的神經網絡硬件可重構實現方法．對神經網絡的可重構特征進行了分析，提出了三種主要的可重構單元；研究了可重構的脈動體系結構及BP網絡到該結構映射算法；探討了具體實現的相關問題．結果表明，這種方法不僅靈活性強。其實現的硬件也有較高的性價比，使用一片FPGA中的22個乘法器工作于100 MHz時，學習速度可達432M CUPS．

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