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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的CPLD半整數分頻器設計方案

      基于FPGA的CPLD半整數分頻器設計方案

      2021-03-22 | zip | 0.38 MB | 次下載 | 免費

      資料介紹

      簡要介紹了 CPLD/FPGA器件的特點和應用范圍,并以分頻比為2.5和15的分頻器的設計為例,介紹了在 Maxplusll開發軟件下,利用ⅤHDL硬件描述語言以及原理圖的輸入方式來設計數字邏輯電路的過程和方法。該設計具有結構簡單、實現方便、便于系統升級的特點。

      基于FPGA的CPLD半整數分頻器設計方案

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