資料介紹
用軟件實(shí)現(xiàn) CRC 校驗(yàn)碼計(jì)算很難滿足高速數(shù)據(jù)通信的要求 ,基于硬件的實(shí)現(xiàn)方法中 ,有串行經(jīng)典算法 LFSR 電路 以及由軟件算法推導(dǎo)出來的其它各種并行計(jì)算方法。以經(jīng)典的LFSR 電路為基礎(chǔ) ,研究了按字節(jié)并行計(jì)算 CRC 校驗(yàn)碼的 原理 ,并以常見的 CRC - 16 和 CRC - CCITT 為例 ,用 VHDL 語言進(jìn)行了可綜合設(shè)計(jì)。結(jié)果表明這種實(shí)現(xiàn)方法在速度和占 用資源方面優(yōu)于常見的設(shè)計(jì) ,適合在 FPGA 中實(shí)現(xiàn) CRC 校驗(yàn)碼的計(jì)算。
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