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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用FPGA實現一種2Gbps的多數據包透明傳輸機制

      如何使用FPGA實現一種2Gbps的多數據包透明傳輸機制

      2021-04-02 | rar | 0.30 MB | 次下載 | 免費

      資料介紹

      　　基于模塊化設計方法對RocketIO發送器的吉比特數據發送策 略進行了深入研究，提出了一種速率為2Gbps的多數據包透明傳輸的機制。根據此機制，僅配置3個包格式寄存器則可實現對RAM內數據以任意要求的格式發 送，從而解決了利用RocketIO發送數據固有的可升級性差的問題。該透明發送機制展示出其運用Verilog HDL高級語言的設計思想，以及升級性好，復雜度低，實現簡單的優點。該方案已在Xilinx公司的現場可編程門陣列（FPGA）器件XC2VP20上得 到了實現 ，驗證了基于這一發送機制的設計方法的有效性和可行性。 該研究對其它高速串行數據傳輸標準具有廣泛的應用價值.

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