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      電子發燒友網>電子資料下載>模擬數字>全集成低相位噪聲LC壓控振蕩器設計

      全集成低相位噪聲LC壓控振蕩器設計

      2009-12-14 | rar | 444 | 次下載 | 5積分

      資料介紹

      提出了一種應用于ISM 頻段的低相位噪聲LC VCO。電路采用TSMC 0.18μm 1P6M 混合信號CMOS工藝進行設計，芯片版圖面積740μm×700μm。在電源電壓為1.8V 時，后仿真結果表明，電路工作頻率為2.4GHz 時，調諧范圍為23%。在偏離中心頻率1MHz 處，相位噪聲為-124.2dBc/Hz。核心部分功耗約為7.56mW。
      關鍵字：壓控振蕩器、片上電感、Q 值、相位噪聲、CMOS 工藝
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