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      電子發燒友網>電子資料下載>模擬數字>利用Systemverilog+UVM搭建soc驗證環境

      利用Systemverilog+UVM搭建soc驗證環境

      2022-08-08 | pdf | 2.93 MB | 次下載 | 5積分

      資料介紹

      平臺可以在前期規劃好，但是對于搭建平臺的人來說，調試永遠是最大的問題，如果都 將一個個 component 都寫完了，調試起來還是有點痛苦的，所以我更傾向于一步一步的 調試平臺；先寫一個可以 pass 的基本平臺，然后在不斷的擴展該平臺，最后在各個 component 中加入所需要的 function 或者 task。當然，當對搭建平臺數量以后，現在基 本對平臺中的 component 一次性搭建完成，然后調試并添加需要的 function 或者 task 即 可。
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