資料介紹
Characterization fo Cdv_dt Induced Power Loss in Synchronous Buck DC-DC Converters:Synchronous buck converter是最流行的拓撲對VRs (voltage regulators).在這種拓撲中,續流Schottky二極管用一個功率MOS來替代.這會使傳導LOSS在很大程度上減少,但是也會帶來新問題和對器件的要求.一個經常討論的問題是所謂C*dv/dt導致用作同步整流的開關LOSS. C*dv/dt會導致MOS的開通,在體二極管恢復時.MOS上增長的電壓通過D,G間電容會導致一個門極電壓產生.感應的電壓可能會短時間開通FET.Vds電壓和電流的交疊會導致額外的LOSS. C*dv/dt的問題由于牽涉到Vds的斜率(由許多因數決定)而變得復雜,另外也和MOSFET特征(極間電容,內部門極電阻,門檻電壓,體二極管特征,封裝特征),以及驅動能力,LAYOUT有關.本文首先基于詳細的器件特征,LOSS模型,in-circuit測試來量化C*dv/dt導致的LOSS,然后通過一個簡單而實用的方法來實驗證明之.結果顯示C*dv/dt很大程度上依賴于開關頻率,輸入電壓,負載條件等.結果也指出C*dv/dt導致FET開通的好處----減少同步FET Vds的振鈴(由體二極管反身恢復及寄生電感引起).FET封裝的寄生電感以及體二極管反向恢復必須最小化,為了允許優化設計silicon(with high C*dv/dt immunity)而最大化電路效率,并且不會產生過多的振鈴發生.
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