資料介紹
在移動計算時代,片上系統(SoC)的設計已經變得更為復雜,因為在設計過程中面臨著諸多挑戰,如需遵循針對高級流程節點的復雜設計規則,需采用低功率電路設計技術,并放大電路的尺寸。電源完整性是設計方案能被成功簽核的關鍵因素之一。本文介紹了一種新的工具,與其他現有技術相比較,它不僅能將電源完整性分析與簽核的速度提高10倍,同時還能達到類似于集成電路通用模擬程序(SPICE)的準確度。該工具將一套完整的設計實現和簽核工具整合到一起,以便更好地克服在簽核過程中遇到的挑戰,從而實現業內最快的設計收斂流程。
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