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      電子發燒友網>電子資料下載>電源技術>高速數字電路電源分配網絡設計與噪聲抑制分析_丁同浩

      高速數字電路電源分配網絡設計與噪聲抑制分析_丁同浩

      2015-04-15 | pdf | 3415KB | 次下載 | 3積分

      資料介紹

      隨著電路系統向著高速度、低電壓、低功耗的趨勢發展，數字、模擬以及射頻等模塊集成到一個電路模塊中以獲得更小的體積和更高的性能。系統能力的提高引發了更大的開關電流，對電源分配網絡的供電能力提出了更高的要求并且引發了更嚴重的供電噪聲波動。電源分配網絡是高速數字電路系統設計的基礎，直接影響了信號完整性、電源完整性以及電磁完整性的性能，因此電源分配網絡的設計與分析一直都是研究的重點。電源分配網絡為數字電路提供電荷的同時也為噪聲提供了優異的傳播路徑，因此電源分配網絡既要保證供電性能又要抑制噪聲的影響，使得電源分配網絡的設計日益復雜。本論文在前人研究成果的基礎上，系統地分析了電源分配網絡的構成及元件功能，重點研究了與電源分配網絡緊密聯系的噪聲建模、抑制以及特性分析，研究取得了一定的成果。
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