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隨著通信系統(tǒng)中邏輯及系統(tǒng)時(shí)鐘頻率的迅速提高和信號邊沿不斷變陡，PCB 的走線和板層特性對系統(tǒng)電氣性能
的影響也越發(fā)顯著。對于低頻設(shè)計(jì)，走線和板層的影響要求不高甚至可以完全忽略不計(jì)。當(dāng)頻率超過 50MHz 時(shí)，PCB
走線則必須以傳輸線考慮，而在評定系統(tǒng)性能時(shí)也必須考慮 PCB 板材的電參數(shù)影響。當(dāng)系統(tǒng)時(shí)鐘頻率達(dá)到 120MHz
及更高時(shí)，就只能使用高速電路設(shè)計(jì)方法，否則基于傳統(tǒng)方法設(shè)計(jì)的 PCB 將無法工作。因此，高速電路設(shè)計(jì)技術(shù)
已經(jīng)成為電子系統(tǒng)設(shè)計(jì)師必須采取的設(shè)計(jì)手段，只有通過使用高速電路設(shè)計(jì)師的設(shè)計(jì)技術(shù)，才能實(shí)現(xiàn)設(shè)計(jì)過程的
可控性。高速系統(tǒng)的設(shè)計(jì)必須面對互連延遲引起的時(shí)序問題以及串?dāng)_、傳輸線效應(yīng)等信號完整性問題。
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